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1.VHDL语言基础
VHDL 概 概 述:
- VHDL VHSIC Hardwarter Description Language
- Very High speed integrated circuit
- VHDL 是美国国防部在20世 世纪 纪80 年代初 为实现 其高速集 成电路硬件VHSIC计 计 划 提 出 的描述语言;
- IEEE 从1986 年开始致力于 于VHDL 标准化 工 作 , 融 合 了其它ASIC 芯片制造 商开发 的 硬件 描述语言的优点,于93 年形成 了标准版 本( (IEEE.std_1164) ) 。
- 1995年 , 我 国国家技术监督局推荐VHDL做 做 为电 子 设计 自动化硬件 描述语言的国家标准。
VHDL的优点:
- 覆盖面广,系统硬件描述能 力强 ,是一 个多层次的硬 描述语言;
- VHDL 语言 具 有 良好 的可 读性 , 既 可以 被 计算机 接受 , 也容易被人们所理解;
- VHDL 语言可以 与 工艺 无关 编程;
- VHDL 语言 已做 为一种IEEE 的工 业标准 , 便 于 使 用、交流 和 推广 。
1.1.标识符 (Identifiers)
标 识符用来定义常数、 变量 、 信号 、 端口 、 子程序或参数的名字,由字母 母(A~Z,a~z) 、数字(0~9)和下划线 线(_)字符组成。
要求 :
- 首字符必须是字母
- 末字符不能为下 划 线
- 不允许出现两个连续的下划线
- 不区分大小写
- VHDL定义的保留字(关键字),不能用作标识符
- 标识符字符 最长可以是可以是32个字 符 。
注意:注释由两个连续的虚线( -- )引 导
关键字(保留 字):
关键字((keyword))是 是VHDL中具有特别含义的单词 , 只能做为固定的用途 ,用户不能用其做为标识符。
如: ABS, ACCESS , AFTER , ALL , AND , ARCHITECTURE, ARRAY , ATTRIBUTE , BEGIN, BODY , BUFFER , BUS , CASE , COMPONENT , CONSTANT , DISCONNECT , DOWNTO , ELSE, ,ELSIF , END , ENTITY , EXIT , FILE , FOR , FUNCTION, GENERIC , GROUP , IF , INPURE , IN ,INOUT , IS , LABEL, LIBRARY , LINKAGE , LOOP , MAP , MOD , NAND , NEW , NEXT, ,NOR , NOT , NULL , OF , ON , OPEN , OR , OTHERS , OUT, PACKAGE , , POUT , , PROCEDURE , PROCESS , PURE , RANGE , RECODE , REM , REPORT , RETURN , ROL , ROR , SELECT, SHARED , SIGNAL , SLA , SLL , SRA , SUBTYPE , THEN, TRANSPORT , TO , , TYPE , UNAFFECTED , UNITS , UNTIL , USE, VARIABLE , WAIT , WHEN , WHILE , WITH ,XOR , XNOR。
1.2.数据对象(Date Objects)
数据对象包括常量 、变量 、信号和文件四种类型 。
-
常量 Constant
常量是对某一常量名赋予一个固定的值 ,而且只能赋值一次 。通常赋值在程序开始前进行, 该值的数据类型则在说明语句中指明。
Constant 常数名 :数 据 类 型 : =表达式
例子:
Constant Vcc :real:=5.0; -- 定义Vcc的数据类型是实数, 赋值为为5.0V
Constant bus_width: integer := 8; --定义总线宽度为常数8
注意事项:
- 常量所赋的值应和定义的数据类型一致 ;
- 常量在程序包 、实体 、构造体或进程的说明性区域内必须加以说明 。 定义在程序包内的常量可供所含的任何实体 、构造体所引用, 定义在实体说明内的常量只能在该实体内可见 , 定义在进程说明性区域中的常 量只能在该进程内可见。
-
变量Variable
变量只能在进


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